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04663
11/05/2005

Prédiction de la fiabilité des MEMS-RF capacitifs par caractérisation de diélectriques

D.DE CONTO, S.MELLE, D.DUBUC, S.ASSIE-SOULEILLE, N.MAURAN, K.GRENIER, R.PLANA

CISHT, 2I

Manifestations avec acte à diffusion limitée : XIVe Journees Nationales Microondes (JNM'2005), Nantes (France), 11-13 Mai 2005, 4p. , N° 04663

Diffusable

103616
04651
01/11/2004

Rapport final d'avancement des travaux dans le cadre du laboratoire commun, Laboratoire Circuits Intégrés de Puissance SMARTMOS

M.BAFLEUR, A.CAZARRE, J.M.DILHAC, J.M.DORKEL, C.GANIBAL, H.GRANIER, K.ISOIRD, A.MARTY, N.MAURAN, F.MORANCHO, N.NOLHIER, B.ROUSSET, D.RAMIS, G.SARRABAYROUSE, E.SCHEID, P.TOUNSI, H.TRANDUC, L.ALLIRAND, F.BERGERET, L.BERTOLINI, J.L.CHAPTAL, A.DERAM, I.DERAM, E.HEMON, P.HUI, C.LOCHOT, B.LOPES, J.MARGHERITTA, B.PETERSON, P.RENAUD, J.M.REYNES, M.ZECRI, S.ALVES, I.BERTRAND, P.BESSE, A.FEYBESSE, J.P.LAINE, L.MONTAGNER-MORANCHO, O.PERAT, S.ROUX, C.SALAMERO, J.B.SAUVEPLANE, O.GONNARD

2I, TEAM, CIP, TMN, FREESCALE, LCIP2

Rapport de Contrat : Contrat LCIP N°1411684-00, Novembre 2004, 78p. , N° 04651

Non diffusable

103042
03558
01/10/2004

Latch-up ring design guidelines to improve electrostatic discharge (ESD) protection scheme efficiency

D.TREMOUILLES, M.BAFLEUR, G.BERTRAND, N.NOLHIER, N.MAURAN, L.LESCOUZERES

CIP, ON Semiconductor, 2I

Revue Scientifique : IEEE Journal of Solid-State Circuits, Vol.39, N°10, pp.1778-1782, Octobre 2004 , N° 03558

Diffusable

103287
03471
01/11/2003

Méthodologies d'analyse des signatures de défaillance de circuits intégrés électriquement stressés

N.GUITARD, D.TREMOUILLES, N.MAURAN, M.BAFLEUR, N.NOLHIER

CIP, 2I

Rapport de Contrat : Contrat CNES DTS/AQ/EQE/AE-2002, Novembre 2003, 55p. , N° 03471

Diffusion restreinte

101432
03152
28/09/2003

Solving ESD protection latchup guard rings issue during electrostatic discharge (ESD) events

D.TREMOUILLES, M.BAFLEUR, G.BERTRAND, N.NOLHIER, N.MAURAN, L.LESCOUZERES

CIP, ON Semiconductor, 2I

Manifestation avec acte : IEEE 2003 Bipolar/BiCMOS Circuits and Technology Meeting (BCTM'2003), Toulouse (France), 28-30 Septembre 2003, pp.137-140 , N° 03152

Diffusable

101205
03397
02/07/2003

Conception et réalisation d'un banc de caractérisation sous pointes pour mesures impulsionnelles haute énergie

N.MAURAN

2I, CIP

Diplôme-Ingénieur C.N.A.M. : Diplôme-Ingénieur, Centre National des Arts et Métiers, Toulouse, 2 Juillet 2003, 144p., Président: M.SURREL, Examinateurs: M.NOLHIER, M.OTRIO , N° 03397

Diffusable

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Résumé

Les décharges électrostatiques (ESD) sont une des principales causes de défaillance des circuits intégrés modernes. Une forte sensibilité aux décharges électrostatiques peut engendrer des dégâts dans le composant qui dégradent ses performances ou le détruisent. Une des méthodes qui peut être employée pour caractériser la robustesse de ces composants est la mesure TLP (Transmission Line Pulsing). Cette méthode, basée sur la charge et la décharge d'une ligne coaxiale, permet de donner les paramètres dynamiques des composants pour des niveaux de courant et des temps de stimulus proches du modèle HBM (Human Body Model) : courants de quelques ampères pour des durées d'impulsions de 100 ns. L'objectif de ce mémoire est de concevoir, de réaliser puis d'automatiser un banc de caractérisation par TLP. Le système automatisé permet de caractériser les composants en boîtiers ou directement sur plaquette, ce qui permet dans ce cas d'effectuer un traitement statistique sur l'ensemble des composants présents sur la plaquette. Il permet également de caractériser les composants à faible niveau de courant (test non destructif) et de trouver le niveau de courant provoquant la destruction du composant. Ce mémoire présente successivement l'étude théorique du banc, le choix de l'appareillage qui le constitue, la réalisation matérielle et logicielle et enfin une validation des mesures réalisées.

Abstract

Nowadays, electrostatic discharges (ESD) are one of the leading origine of failure in the integrated circuits. A strong ESD susceptibility can generate damages in the device that reduce its performances or destroy it. One method which can be used to characterize the stoutness of these devices is the TLP measurements (Transmission Line Pulsing). This method, based on the charge and the discharge of a coaxial cable, gives the dynamic parameters of the component, with stimulus time and current values near of the Human Body Model (HBM) : pulse width of 100ns and current of few amps. The aim of this project is to design, to realise and to automate a TLP measurement bench. The automated system allows to characterize devices in package or at the wafer level, which offers the possibility of statistical treatment on all the comonents existing on the wafer. Also, it offers the possibility of low-level measurement to appreciate the default criteria. This manuscript presents the thorical study of the measurement bench, the choice of its constituting components, the hardware and software realization and finally, the validation of the measurements.

Mots-Clés / Keywords
Transmission Line Pulse; Décharge électrostatique (ESD); Caractérisation impulsionnelle; Human Body Model; Critère de défaillance; Semiconductor; Semi-conducteurs; Electrostatic discharge (ESD); Pulsed characterization; Default criteria;

101209
01476
01/10/2001

Substrate current injection on P-/P+ substrate

J.P.LAINE, O.GONNARD, G.CHARITAT, M.BAFLEUR, N.MAURAN

CIP, 2I

Rapport LAAS N°01476, Octobre 2001, 30p.

Diffusion restreinte

48336
00036
01/09/2001

Analysis and compact modeling of a vertical grounded-base NPN bipolar transistor used as an ESD protection in a smart power technology

G.BERTRAND, C.DELAGE, M.BAFLEUR, N.NOLHIER, J.M.DORKEL, Q.NGUYEN, N.MAURAN, D.TREMOUILLES, P.PERDU

CIP, ON Semiconductor, CNES-THALES, 2I

Revue Scientifique : IEEE Journal of Solid-State Circuits, Vol.36, N°9, pp.1373-1381, Septembre 2001 , N° 00036

Diffusable

47284
01667
01/09/2001

Analysis and compact modeling of a vertical grounded-base NPN bipolar transistor used as ESD protection in a smart power technology

G.BERTRAND, C.DELAGE, M.BAFLEUR, N.NOLHIER, J.M.DORKEL, Q.NGUYEN, N.MAURAN, D.TREMOUILLES, P.PERDU

ON Semiconductor, ISGE, 2I, CNES-THALES

Revue Scientifique : IEEE Journal of Solid-State Circuits, Vol.36, N°9, pp.1373-1381, Septembre 2001 , N° 01667

Lien : http://hal.archives-ouvertes.fr/hal-00143927

Diffusable

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Abstract

A thorough analysis of the physical mechanisms involved in a Vertical Grounded-Base NPN bipolar transistor (VGBNPN) under ElectroStatic Discharge (ESD) stress is first carried out by using 2D-device simulation, Transmission Line Pulse measurement (TLP) and photoemission experiments. This analysis is used to account for the unexpected low value of the VGBNPN snapback holding voltage under TLP stress. A compact model based on a new avalanche formulation resulting from the exact resolution of the ionization integral is therefore proposed

Mots-Clés / Keywords
Bipolar; compact modeling ; ESD; Smart-power; 2D; Simulation;

110021
00136
24/09/2000

Analysis and compact modeling of a vertical grounded base NPN bipolar transistor used as an ESD protection in a smart power technology

G.BERTRAND, C.DELAGE, M.BAFLEUR, N.NOLHIER, J.M.DORKEL, Q.NGUYEN, N.MAURAN, P.PERDU

CIP, ON, CNES, 2I

Manifestation avec acte : 2000 Bipolar/BiCMOS Circuits and Technology Meeting (BCTM'2000), Minneapolis (USA), 24-26 Septembre 2000, pp.28-31 , N° 00136

Diffusable

40735
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